张玲玲
- 作品数:8 被引量:6H指数:2
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- 浮点数加/减运算执行控制器
- 一种浮点数加/减运算执行控制器,包括浮点操作数配置控制模块、浮点数加/减运算器、脉冲分配器、结果输出控制模块;该执行控制器应用FPGA设计硬连接控制电路,执行控制器被系统选中,启动脉冲分配器,在内部脉冲分配器的时序脉冲控...
- 蔡启仲余玲李克俭张玲玲王鸣桃
- 文献传递
- 基于FPGA自主控制浮点加减控制器设计被引量:2
- 2014年
- 为实现一种能够自主完成浮点数加/减运算功能的浮点数加/减运算执行控制器,提出了一种基于采用FPGA并行操作电路硬连接的浮点数加/减运算控制电路及其时序控制方法;该控制器在接收到操作数类型与参与运算的操作数后,在内部时序脉冲作用下.可以自主完成操作数的配置以及浮点数加/减法运算的功能,运算结果传输到系统数据总线;论述了该控制器的电路构成和基本原理,分析操作数类型与操作数在内部时序脉冲作用下的执行过程,应用Verilog HDL语言实现相关硬件的构建和连接;设计完成后通过仿真测试可知,该控制器运行的最高频率可达178.317 M,从输入端口到输出端口的延时数据为:最小延时是3.185 ns,最大延时是15.336 ns,耗用的IO输入输出端口占总资源的27.92%,数据表明该控制器提高了运算器的运算速度,且能够自主完成浮点数加/减运算。
- 张玲玲李克俭蔡启仲
- 关键词:FPGA控制器
- 浮点数加/减运算执行控制器
- 一种浮点数加/减运算执行控制器,包括浮点操作数配置控制模块、浮点数加/减运算器、脉冲分配器、结果输出控制模块;该执行控制器应用FPGA设计硬连接控制电路,执行控制器被系统选中,启动脉冲分配器,在内部脉冲分配器的时序脉冲控...
- 蔡启仲余玲李克俭张玲玲王鸣桃
- 文献传递
- 基于FPGA的PLC数据输出控制IP核设计被引量:1
- 2014年
- 提出应用FPGA设计PLC数据输出控制IP核的思路。该IP核执行输出数据相关命令时,在内部时序脉冲控制下按照Y编号地址自主完成数据在存储单元的寻址和读写操作;论述了控制器的工作原理和电路设计,应用Verilog语言实现硬件电路的构建及功能;测试表明:该IP核可以自主完成对数据处理和输出要求,使数据输出与系统其它功能模块实现并行处理,提高了PLC运行速度。
- 周曙光李克俭蔡启仲李静张玲玲
- 关键词:FPGA数据输出IP核
- 基于FPGA的PLC输入存储与读取控制器的设计被引量:3
- 2014年
- 提出应用FPGA设计PLC的输入存储与读取控制器的思路。分析了PLC开关量状态的采集、存储和读取过程,设计了该控制器的电路构成和基本原理,在输入采集命令作用时,在内部时序脉冲控制下自主完成4位1组的数据组合并存入存储矩阵中,在PLC用户程序执行过程中,实现位信息读取、高速位信息读取和数据信号的读取。应用Verilog HDL语言实现相关硬件的构建和连接。测试表明:该控制器可以自主完成每条命令的功能,提高了PLC执行指令序列的操作速度。
- 李静蔡启仲张炜张玲玲
- 关键词:PLCFPGA控制器
- 基于FPGA的多浮点操作数算术运算控制器的设计
- FPGA是一种可编程的IC芯片,能够用于具有复杂算法的运算器、数字滤波器等逻辑运算单元和信号处理单元。本课题主要是运用FPGA并行操作的特点来设计多操作数浮点算术运算控制器,其主要功能为:该控制器被系统选中后,在内部时序...
- 张玲玲
- 关键词:FPGA控制器
- 文献传递
- 浮点数加/减运算执行控制器
- 一种浮点数加/减运算执行控制器,包括浮点操作数配置控制模块、浮点数加/减运算器、脉冲分配器、结果输出控制模块;该执行控制器应用FPGA设计硬连接控制电路,执行控制器被系统选中,启动脉冲分配器,在内部脉冲分配器的时序脉冲控...
- 蔡启仲余玲李克俭张玲玲王鸣桃
- 文献传递
- 基于FPGA的多操作位逻辑运算控制器的设计被引量:2
- 2015年
- 提出了应用FPGA设计可执行多操作位逻辑运算控制器的思路,该控制器接收到逻辑运算命令与多操作位后,在内部时序脉冲作用下,可以自主完成PLC逻辑运算指令的功能,运算结果传输到系统数据总线。设计多操作位逻辑运算的PLC指令,论述了该控制器的电路构成和基本原理,分析指令在内部时序脉冲作用的执行过程并给出了流程图,应用Verilog HDL语言实现相关硬件的构建和连接,应用梯形图程序进行仿真测试。测试表明:该控制器可以自主完成每条指令的运算,实现了逻辑运算指令的执行与系统其他功能模块的并行处理,提高了PLC执行指令序列的速度。
- 李静蔡启仲蒋玉新周曙光张玲玲
- 关键词:PLCFPGA逻辑运算控制器