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一种异或门鉴相器: 本发明公开了一种异或门鉴相器，通常与数字模块构成一个环路使用，包括四输入电流模逻辑异或门鉴相器和流水线比较器，流水线比较器包括第一电阻分压网络、第二电阻分压网络及多个比较器。四输入电流模逻辑异或门鉴相器，通过两个输出电压...; 张东亮张若平

一种利用异或门实现DAC差分输出电路: 本申请利用异或门实现DAC差分输出电路，包括异或门电路、解码电路和音频运放电路；所述异或门电路接入I2S接口的输入信号，所述异或门电路的输出端与解码电路相连；所述异或门电路能够向解码电路输出多路不同的数字信号；所述解码电...; 黄德超唐小虎蒲立孙晓路

基于异或门的动态可重构的ROPUF设计与验证: 2024年; 阐述物理不可克隆函数(Physical Unclonable Function,PUF)技术的新结构、响应纠错、安全性及其应用,这是可重构物理不可克隆技术电路结构的研究,属于PUF新结构研究的一个分支。针对已提出的环形振荡器物理不可克隆函数(Ring Oscillator Physical Unclonable Functions,RO PUF)鲁棒性不足的缺点,提出基于异或门的可重构环形振荡器(XOR Ring Oscillator,XOR RO)的物理不可克隆函数电路。为了验证新型PUF结构的有效性。借助Vivado工具制造硬宏,在多块同型号Xilinx XCVU440上分析基于异或门的可重构环形振荡器的物理不可克隆函数电路。相比传统ROPUF,基于异或门的可重构环形振荡器的物理不可克隆函数电路,展现更高的片间汉明距离和更低的片内汉明距离。; 赵达张竣昊魏江杰张锐骆思成; 关键词：环形振荡器可重构异或门

基于磁电效应的自旋逻辑器件、可重构与门、异或门: 本发明公开了一种基于磁电效应的自旋逻辑器件、可重构与门、异或门，包括：MTJ结构和磁电层，其中，所述MTJ结构为从上至下顺序堆叠的磁固定层、绝缘势垒层和磁自由层组成，所述磁电层设在所述磁自由层左侧；所述磁固定层具有垂直各...; 王森张永锋李鹤楠

一种适用于物联网设备的基于异或门的Pico物理不可克隆函数: 2024年; 针对可重构Pico-PUF对机器学习建模攻击抵抗能力较弱,本文对RPPUF进行了改进,提出了一种基于异或门的抗ML攻击的可重配置Pico-PUF,即XORPPUF.通过将可配置逻辑中的每个非门替换为异或门,并将PUF的输出进行混淆处理,提高了PUF抗ML攻击能力,同时保持PUF性能.在Xilinx Spartan-6XC6SLX25FPGA开发板上实现并验证了提出的XORPPUF.实验结果表明,XORPPUF实现了46.01%的唯一性、99.10%的温度可靠性以及49.1%的均匀性.与RPPUF结构相比,提高了0.21%的唯一性、1.10%的均匀性以及72×的挑战开销比率.不仅如此,对于支持向量机、逻辑回归、决策树、随机森林和人工神经网络攻击时的识别准确率,提出的XORPPUF相比RPPUF分别降低了47.40%、31.37%、12.63%、13.83%和41.16%,即XORPPUF在抗ML攻击中也有着比RPPUF更好的表现.因此更适合资源有限的物联网设备.; 王骏君黄钊刘锦辉樊璐万波王泉; 关键词：异或门硬件安全 FPGA

同或门电路、调节方法及异或门电路: 本发明实施例提供了一种同或门电路、调节方法及异或门电路，涉及逻辑电路技术领域。同或门电路包括第一输入模块、第二输入模块、输出模块及延时模块。第一输入模块的输入端用于电连接于第一信号源，第一输入模块的第一输出端与延时模块的...; 沈畅吴海斌

一种减小与非门输入信号延时的异或门电路: 一种减小与非门输入信号延时的异或门电路，包括传输门模块、非门模块、与非门模块和驱动模块，在路径1中输入信号A和B经过传输门模块和非门模块后输入与非门模块，在路径2中输入信号A和B经过驱动模块后输入与非门模块，随后与非门模...; 李靖吕景昊田明宁宁于奇

一种基于异或门的FPGA输出防上电“误触发”电路: 本发明涉及一种基于异或门的FPGA输出防上电“误触发”电路，属于航空电气技术领域。本发明在FPGA的输出引脚增加防上电“误触发”电路，在不增加FPGA工作量的基础上，确保在上电和配置过程中FPGA不会对输出电路造成“误触...; 姬栋柳邦奇李印国

一种基于多相位采样的可编程异或门TRNG电路: 本发明公开了一种基于多相位采样的可编程异或门TRNG电路，包括振荡电路、熵采样电路和锁相环，振荡电路用以产生无规则的振荡输出信号，包括M个并列设置的基本振荡单元，所述基本振荡单元为基于LUT6‑2的双输出异或门单元；熵采...; 吴新雅王均宜张慧珊闫子豪张安琪张馨怡杨金阳刘常鹏舒雨欣朱旭吴欣雨陆浩晨姚亮郭小辉

具有用于相位检测和相位插值的加权输出段的动态加权异或门: 所描述的方法和系统：由包括多个逻辑分支的动态加权XOR门接收参考时钟信号以及本地振荡器信号相位；生成相位误差信号的多个加权段，该多个加权段包括正加权段和负加权段，所述相位误差信号的每一个加权段具有由所述多个逻辑分支当中的...; 阿明·塔亚丽

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